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[判断题]可逆计数器既能作加法计数，又能作减法计数。
[判断题]区别加法计数和减法计数的主要依据是计数过程中计数器所代表数字的增减情况。
[判断题]全加器只能进行加法计算，不能进行减法计算。
[单项选择]既可以作为加法计数器又可以作为减法计数器的是（）
A. 同步计数器
B. 异步计数器
C. 可逆计数器
D. 集成计数器
[单项选择]实现十进制数加法计数需用（）个触发器。
A. 4
B. 10
C. 2
D. 6
[单项选择]在十进制加法计数器中，当计数器状态为0101时，则表示十进制数的（）
A. 3
B. 4
C. 5
D. 6
[判断题]计数可以从0开始逐个递增达到规定的计数值，也可以从规定的计数值开始逐个递减恢复到0；前者为加法计数器，后者是减法计数器；8253/8254采用后者。
[单项选择]一异步三位二进制加法计数器，当第8个CP脉冲过后，计数器状态变为（）。
A. 000
B. 010
C. 110
D. 101
[单项选择]一异步三位二进制加法计数器，当第4个CP脉冲过后，计数器状态变为（）。
A. 000
B. 010
C. 100
D. 101
[填空题]二进制加法计数器从0计数到十进制24时，需要（）个触发器构成，有（）个无效状态。
[单项选择]四位二进制加法计数器能记的最大十进制数位（）。
A. 15
B. 10
C. 2
D. 16
[填空题]二进制加法计数器从0计数到十进制数25时，需要（）个触发器构成，有（）个无效状态。
[单项选择]一个四位二进制的加法计数器，由0000状态开始，经过25个时钟脉冲后，此计数器的状态为（）。
A. 1000
B. 1001
C. 1010
[单项选择]一个四位二进制的加法计数器，由0000状态开始，经过28个时钟脉冲后，此计数器的状态为（）。
A. 1011
B. 1100
C. 1101
[单项选择]一个五位的二进制加法计数器，初始状态为00000，问经过201个输入脉冲后，此计数器的状态为（）。
A. 00111
B. 00101
C. 01000
D. 01001
[简答题]试描述一个同步置数、同步清零的8位加法计数器，写出FPGA程序。
[单项选择]三位异步二进制加法计数器的输出状态为110，2个脉冲后输出为（）
A. 000
B. 001
C. 101
D. 111
