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[简答题]用原理图或VHDL输入方式分别设计一个周期性产生二进制序列010********的序列发生器，用移位寄存器或用同步时序电路实现，并用时序仿真器验证其功能。（可预置数11位序列发生器）
[简答题]基于原理图输入方式，应用4位全加器（74283）和74374（8D触发器）构成4位二进制加法计数器。如果使用74299（8位通用移位寄存器）、74373（8D锁存器）、D触发器和非门来完成上述功能，应该有怎样的电路？
[简答题]用74283（4位二进制全加器）加法器和逻辑门设计实现一位8421BCD码加法器电路，输入输出均是BCD码，CI为低位的进位信号，CO为高位的进位信号，输入为两个1位十进制数A，输出用S表示。（化简）
[简答题]试描述一个带进位输入、输出的4位全加器，其中端口：A、B为加数，CIN为进位输入，S为加和，COUT为进位输出。写出FPGA程序。
[简答题]利用8个全加器，可以构成一个8位加法器。利用循环语句来实现这项设计。并以此项设计为例，使用GENERIC参数传递的功能，设计一个32位加法器。
[判断题]全加器是一个只能实现本位两个进制数相加的逻辑电路。
[判断题]多媒体数据的输入方式分为两种：即多通道异步输入方式和多通道同步输入方式。
[单项选择]进行程序设计时，( )不是进行输入和输出方式设计时必须考虑的原则。
A. 应允许使用自由格式
B. 应允许默认值
C. 输入格式要简单，以使得输入的步骤和操作尽可能简单
D. 一次最好只输入一个数据，系统确认后再输入下一个数据
[单项选择]全加器是指（）的二进制加法器。
A. 两个同位的二进制数相加
B. 两个二进制数相加
C. 两个同位的二进制数及来自低位的进位三者相加
[简答题]设计一个求补码的程序，输入数据是一个有符号的8位二进制数。
[判断题]全加器只能进行加法计算，不能进行减法计算。
[判断题]在进行系统的输入输出设计时，必须先进行输入设计，然后才进行输出设计。
[简答题]为什么需要半加器和全加器，它们之间的主要区别是什么？
[判断题]译码器、计数器、全加器和寄存器都是组合逻辑电路。
[单项选择]系统输入设计中，采用内部控制方式以确保输入系统数据的有效性， （） 用于验证数据是否位于合法的取值范围。
A. 数据类型检查
B. 自检位
C. 域检查
D. 格式检查
[判断题]在Windows的中文输入方式下，在几种中文输入方式之间切换应按Ctrl+Shift。
